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パッケージ: yosys-abc (0.52-1 など)

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類似のパッケージ:

Sequential Logic Synthesis and Verification Algorithms

ABC is a system for synthesis and verification of binary sequential logic circuits appearing in synchronous hardware designs. It combines scalable logic optimization based on And-Inverter Graphs (AIGs), optimal-delay DAG-based technology mapping for look-up tables and standard cells, and innovative algorithms for sequential synthesis and verification.

This is a fork of berkeley-abc maintained by the YosysHQ team for use in the yosys RTL synthesis framework.

その他の yosys-abc 関連パッケージ

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アーキテクチャ バージョン パッケージサイズ インストールサイズ ファイル
alpha (非公式の移植版) 0.52-1 4,581.5 kB14,403.0 kB [ファイル一覧]
amd64 0.52-1 4,828.4 kB12,925.0 kB [ファイル一覧]
arm64 0.52-1 4,271.4 kB12,054.0 kB [ファイル一覧]
armel 0.52-1 4,085.1 kB11,854.0 kB [ファイル一覧]
armhf 0.52-1 4,253.4 kB8,910.0 kB [ファイル一覧]
i386 0.52-1 4,902.5 kB13,881.0 kB [ファイル一覧]
loong64 (非公式の移植版) 0.52-1 4,555.1 kB13,077.0 kB [ファイル一覧]
m68k (非公式の移植版) 0.52-1 4,523.9 kB13,240.0 kB [ファイル一覧]
mips64el 0.52-1 4,413.2 kB15,073.0 kB [ファイル一覧]
ppc64el 0.52-1 4,906.4 kB15,382.0 kB [ファイル一覧]
riscv64 0.52-1 4,798.1 kB10,774.0 kB [ファイル一覧]
sh4 (非公式の移植版) 0.33-6 5,831.5 kB13,788.0 kB [ファイル一覧]
x32 (非公式の移植版) 0.52-1 4,816.3 kB12,689.0 kB [ファイル一覧]