Package: yosys-doc (0.33-6~exp3)

[ Source: yosys  ]

Experimental package

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infrastruttura per la sintesi di RTL Verilog (documentazione)

Yosys è un'infrastruttura per la sintesi di RTL Verilog. Attualmente ha una gestione ampia di Verilog-2005 e fornisce un insieme di base di algoritmi di sintesi per svariati domini d'applicazione.

Yosys può essere adattato per eseguire qualsiasi lavoro di sintesi combinando i passaggi esistenti (algoritmi) usando script di sintesi e aggiungendo i passaggi aggiuntivi necessari estendendo la base di codice C++ di Yosys.

Questo pacchetto contiene il manuale.

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  infrastruttura per la sintesi di RTL Verilog

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