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套件：yosys-dev（0.9-1 以及其他的）

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相似套件：

Framework for Verilog RTL synthesis (development files)

Yosys is a framework for Verilog RTL synthesis. It currently has extensive Verilog-2005 support and provides a basic set of synthesis algorithms for various application domains.

Yosys can be adapted to perform any synthesis job by combining the existing passes (algorithms) using synthesis scripts and adding additional passes as needed by extending the yosys C++ code base.

This package contains the headers and programs needed to build yosys plugins.

下載 yosys-dev

下載可用於所有硬體架構的
硬體架構 版本 套件大小 安裝後大小 檔案
amd64 0.9-1+b1 60。6 kB323。0 kB [檔案列表]
arm64 0.9-1+b1 60。6 kB323。0 kB [檔案列表]
armel 0.9-1+b1 60。6 kB323。0 kB [檔案列表]
armhf 0.9-1+b1 60。6 kB323。0 kB [檔案列表]
i386 0.9-1+b1 60。6 kB323。0 kB [檔案列表]
mips64el 0.9-1+b1 60。6 kB323。0 kB [檔案列表]
mipsel 0.9-1+b1 60。6 kB323。0 kB [檔案列表]
ppc64el 0.9-1+b1 60。6 kB323。0 kB [檔案列表]
s390x 0.9-1+b1 60。6 kB323。0 kB [檔案列表]