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パッケージ: opensta (0~20191111gitc018cb2+dfsg-1.1)

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類似のパッケージ:

Gate-level Static Timing Analyzer

After synthesis, place and route of a digital circuit, it is necessary to verify the timing of the design. OpenSTA is a tool for doing exactly that. It has a Tcl interface for entering commands for analysing designs.

It typically takes as input a verilog netlist, a liberty file, and other parasitics information from the placed and routed design.

その他の opensta 関連パッケージ

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mips64el 857.3 kB5,493.0 kB [ファイル一覧]