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Paquet : verilator (5.032-1 et autres)

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simulateur Verilog libre et rapide

Verilator est le simulateur Verilog HDL libre le plus rapide, dépassant beaucoup de simulateurs commerciaux. Il compile du Verilog synthétisable (mais pas du code de banc d’essai !), plus quelques assertions PSL, SystemVerilog ou Synthesis dans du code C++ ou SystemC. Il est conçu pour de vastes projets où des performances rapides de simulation sont le souci principal, et il convient parfaitement pour créer des modèles d’exécutables de CPU pour des équipes concevant des logiciels embarqués.

Étiquettes: Domaine: Électronique, Mis en œuvre en: C++, implemented-in::perl, interface::commandline, Rôle: Programme, But: Simulation

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Architecture Version Taille du paquet Espace occupé une fois installé Fichiers
amd64 5.032-1+b1 7 397,2 ko33 157,0 ko [liste des fichiers]
arm64 5.032-1+b1 6 659,4 ko33 836,0 ko [liste des fichiers]
armel 5.032-1+b1 6 171,6 ko27 495,0 ko [liste des fichiers]
armhf 5.032-1+b1 6 142,7 ko22 247,0 ko [liste des fichiers]
i386 5.032-1+b1 7 581,8 ko30 687,0 ko [liste des fichiers]
mips64el 5.032-1+b1 6 523,0 ko44 047,0 ko [liste des fichiers]
ppc64el 5.032-1+b1 7 147,8 ko39 020,0 ko [liste des fichiers]
riscv64 5.032-1 7 374,8 ko30 035,0 ko [liste des fichiers]
s390x 5.032-1+b1 7 063,2 ko34 708,0 ko [liste des fichiers]